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未解决

电源输出加共模,做抗扰测试(如RS/CS等)时,输出掉电压。短路共模可...

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1
dwjnba369
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LV6
高级工程师
  • 2020-7-20 16:08:36
20问答币
有时候,为了CE/RE好过,就在输出端放置一级共模电感

但是,做工业平板电源/导轨电源,要求电源抗扰等级较高,RS/CS/EFT/输出EFT等等测试强度高。


会发现,如果不把输出那个共模电感短路掉,在做如上抗扰测试时,输出的电压会掉坑超过规格范围。


哪位大神知道,共模以什么模型或者形式干扰了输出电压环(光耦或431回路)?
小弟,实际整改发现,把431回路面积减小有好处。把输出功率整流环路面积减小也有好处,共模之后靠近输出端放置对大地的Y电容也有好处,只是不知道这个共模是怎么产生影响的?
截图未命名.jpg 截图未命名1.jpg
nc965
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版主
  • 2020-7-21 16:11:17
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这不好说,有没有规范?
dwjnba369
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LV6
高级工程师
  • 2020-7-21 16:31:00
  • 倒数8
 
现在纠结的不是规范,工业电源抗扰等级要求高是肯定的。实验发现,只要输出端加了共模电感,抗扰就很难过。把电感短路掉就好了。我是想探讨这个共模是以什么形式影响输出环路的。尤其是输出线上耦合4KV的EFT信号的时候,共模引起的输出掉坑问题更为明显。


此时的共模电感,是作为震荡源?还是辐射源?

值得探讨下
nc965
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版主
  • 2020-7-22 18:22:01
  • 倒数7
 
既然你把电感短路掉就好了,那就短路呗。
输出滤波电感对环路的影响是明显的,特别是环路采样(包括采样地)置于电感后时,很容易发飙。原因是多出一个感性器件置于环路中,改变了系统传递函数,使控制更加困难。
如果采样置于电感前也有影响,可以加强电感前滤波电容(以及假负载),让环路把电感视为(感性)负载看待。虽然感性负载对环路也有影响,但较之将电感置于环路内轻微得多。
dwjnba369
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LV6
高级工程师
  • 2020-7-23 10:52:02
  • 倒数6
 
首先,环路的正和负不经过共模电感,在共模之前就形成回路了;其次,输出端共模都是用低u磁环绕几圈,都是几uH的小感量。
最后,共模之后还会放电容。


对环路影响可以忽略不计,环路测试仪实测通过,满足奈奎斯定律。

之所以输出加共模,是为了调RE和CE。

我问的问题是,在做抗扰测试的时候,共模是怎么影响输出电压的。不是让你叫我短路共模,答非所问了。
dwjnba369
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LV6
高级工程师
  • 2020-7-23 11:35:06
  • 倒数5
 
!@#¥%
dwjnba369
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LV6
高级工程师
  • 2020-7-23 11:39:42
  • 倒数4
 
有兴趣讨论的大神,请注意审题,我问的是抗扰测试的时候,输出端的共模是如何影响输出电压环的。解决的方法大把,我问的不是解决的办法。

wl777wl
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LV8
副总工程师
  • 2020-7-28 20:04:22
  • 倒数3
 
你后级反馈环路把原理图给清楚了,再说
dwjnba369
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LV6
高级工程师
  • 2020-7-29 09:43:57
  • 倒数2
 
RS.jpg 耦合器.jpg
右图是EFT信号耦合器,输出负载线经过耦合器,被EFT信号耦合干扰。EFT信号有两种,如图

1.jpg 2.jpg
dwjnba369
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LV6
高级工程师
最新回复
  • 2020-7-29 11:02:20
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