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已解决

用UC3843做一个开关电源,带载出现严重干扰,MOS管在一个周期内导通两次

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a740580318
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本网技工
  • 2016-8-20 13:38:31
100问答币
如上所述,电路图在附件。并且UC3843的电流反馈脚瞬间达到3V左右,PWN波占空比直接被锁死,无法打开。

710-00255-00.pdf

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MOS管DS加RC吸收对效率不好。 这个波形完全可以在检流电阻后面到3脚之间加入RC滤掉的。
tanb006
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实习版主
  • 2016-8-20 22:27:37
 
把C26 从221改成102再试。
先把斜坡补偿去掉。空载或轻载电路调好了再加入斜坡补偿。
否则你都不知道是哪里的问题。
a740580318
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本网技工
  • 2016-8-21 14:42:08
 
空载的时候3脚电压瞬间达到3V左右。当初怀疑是因为斜率补偿电压过到3脚导致电压过高,但是斜率补偿已经去掉了、现在的问题就是空载的时候没干扰,但是一带载的时候发现整个IC的电压都在抖动,这是什么问题?
tanb006
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LV7
实习版主
  • 2016-8-21 19:17:54
 
你变压器如果没有算错的话,这原理图没啥问题的。
初级电感量多少?
a740580318
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本网技工
  • 2016-8-22 08:36:52
 
初级电感量250MH,这个应该也没什么问题,我都把高压侧保护D14直接去掉了。
tanb006
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实习版主
  • 2016-8-22 12:00:23
 
那就是环路问题了。
431的自激是经常的事。
有的431不合格,的确是这样。换另一个厂家的就好了。
也有环路的参数没整好,或者是布线的问题引入了干扰造成自激。
最好能有一个电路一样的电源就好对比了。
a740580318
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本网技工
  • 2016-8-22 14:17:43
 
这是新设计的,是从原有机型上面抠出来的,对比发现原来机型根本就没有这类问题,然后我将环路参数全部换成跟原来机型参数一致,发现问题依然存在,至于您所说的431已经更换,效果甚微,这个干扰是不是由于光耦隔离而出来的?
cap65
  • cap65
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高级工程师
  • 2016-8-21 21:31:53
 
你的环路非常规啊?可能是环路不稳,引起PWM在抖动,我遇到过此问题。
a740580318
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本网技工
  • 2016-8-22 08:37:24
 
环路不稳?大神怎么解决?
tanb006
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实习版主
  • 2016-8-22 12:33:54
 
环路的内容就跟变压器的磁学一样高深莫测。
环路的课程看了N次了。依然糊涂一片。
按书上方法算出来的环路总是不对。
用笨方法试验来的参数,又跟算的相差到离谱。
搞了好几年,对环路依然是处于经验解决的状态。。。。。
a740580318
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本网技工
  • 2016-8-22 14:30:55
  • 倒数10
 
我这个电路图是按照已经成熟机型上面抠出来的,环路参数应该没有问题,可能是由于干扰导致的吧。。
我在想是不是光耦隔离或者IC电流反馈脚上的取样电阻对地导致干扰出现?大神麻烦看下布局是不是存在问题(图片为PCB样品)

附件原理图PCB反面

附件原理图PCB反面

附件原理图PCB正面

附件原理图PCB正面
tanb006
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实习版主
  • 2016-8-22 15:51:45
  • 倒数9
 
3843的5脚接地,要尽量跟检测电流的电阻的地放在一起,再走到电容引脚上去。
否则你检测出来的3脚波形就会变了很多。
你可以对比下,示波器夹在5脚和3脚上,和示波器夹在检流电阻上的波形,
看看是不是一样,有没有畸变,如果有畸变,那就改变地线的走向再试。
a740580318
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本网技工
  • 2016-8-22 17:59:56
  • 倒数8
 
改变地线走向?具体怎么实行呢?
a740580318
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本网技工
  • 2016-8-22 18:34:33
  • 倒数7
 
刚抓了3843的3脚波形和检测电阻的波形  如图所示, 存在明显的畸变。改变地线走向之后,发现效果甚微, 本帖最后由 a740580318 于 2016-8-22 19:30 编辑

3843的3脚波形图

3843的3脚波形图

检测电阻的波形图

检测电阻的波形图

对比图

对比图
tanb006
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实习版主
  • 2016-8-23 03:26:32
  • 倒数6
 
改变地线走向,需要把原来的铜箔隔断,5脚和检流电阻的地要尽可能的近。再从检流电阻走到电容的负端。
a740580318
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本网技工
  • 2016-8-23 10:14:02
  • 倒数5
 
按照您的方案执行了,波形问题解决了。在示波器图中(15)当电压反馈到达三脚过后有个尖峰,按照理论,这个尖峰不应该存在或者峰值很小,最大值在20V左右,我的想法是:在PCB板上的地是整流过后的VCC地,还有变压器初级VCC地,这两个地在原理图上是共通的,是否可以将两个地直接短接?这个方法是否可行? 本帖最后由 a740580318 于 2016-8-23 11:51 编辑

tanb006
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实习版主
  • 2016-8-23 15:49:50
  • 倒数4
 
短接地应该没什么用的。
因为你接的并不是地球的大地。
前面的小尖峰得用RC滤波电路去吸收。一级RC不行就用两级。
滤除尖峰,保留后面的三角波。
a740580318
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本网技工
  • 2016-8-23 16:48:36
  • 倒数3
 
MOS管加RC滤波电路,吸收不掉的毛刺直接回流至IC三脚,导致尖峰更高(我测试中发现此现象) 本帖最后由 a740580318 于 2016-8-24 10:56 编辑

tanb006
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实习版主
  • 2016-8-24 22:47:48
  • 倒数2
 
MOS管DS加RC吸收对效率不好。
这个波形完全可以在检流电阻后面到3脚之间加入RC滤掉的。
a740580318
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本网技工
  • 2016-8-22 11:05:56
 
整个IC工作状态都有问题。。。 是不是我环路参数设置有问题还是某个元器件受损导致?
瓦系大坏蛋
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本网技工
最新回复
  • 2018-12-4 19:22:48
  • 倒数1
 
我也遇到了类似问题。楼主不知道是否已经解决。
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