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未解决

[疑問] SRC-LLC 諧振短路保護波形

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1
心心所向
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LV4
初级工程师
  • 2019-3-27 01:54:59
10问答币
Hi 大家好:
有個問題一直困擾我。希望有大神可以幫忙解答。
LLC電路,在輸出正常作短路。是否要保証在MOS不能工作在LLC的容性區下
我一開始是認為需要的。但是最後抓到的短路波形是在容性區 (應該沒有看錯) 。
不知道各位是怎麼看這個波形的。

CH3:一次側 mos Vds, ch4:諧振電流
SCP-1.png

SCP-2.png

SCP-3.png







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SCP-2.png
SCP-3.png
qiuyuqiang01
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LV6
高级工程师
  • 2019-3-27 12:51:15
  • 倒数2
 
我觉得是容性区,因为电流反向后MOS才动作。我以前的做法是用电子负载加载,一直加到出现ZCS,也就是容性区的临界点,记下此时的工作频率,把芯片的最低频率限制在这个频率以上并留有余量,再短路就没有问题了。当然还有就是你要测试一下满载启动,看一下启动时出现的最低频率是否低于你设置的限制频率点,如果低了要想想办法,否则会影响你的启动能力
bake_ql
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LV8
副总工程师
最新回复
  • 2019-3-27 22:00:13
  • 倒数1
 
限制最低频率,但是如果你要想彻底不进入容性区,需要最低点设定在谐振点,不是很现实;

因此设定最低点,保证满载和holdup 时候不在容性区即可,并在过载乃至短路电路要快速拉高频率,重载高频增益可以很低的,短路都没有问题,当然关断损耗会比较大,散热需要注意
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