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未解决

全桥LLC电路,Vgs波形有关断下冲,波形震荡贼难看

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多嘉腊孜
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高级工程师
  • 2022-7-2 21:05:42
10问答币
全桥LLC电路,驱动电路如下,MOS管IRF540

d1c6f91e07c18e0ed67110269a9dc05.png

驱动波形Vgs,未加输入电压
c9e2b62498266ffefce38ea678a4489.jpg


驱动波形Vgs,加输入电压
2941e2553eaea12fdc4d7a8c15da085.jpg


Vds波形,震荡尖峰很大,是输入电压一倍多
d382680e48de1f895d8fb0cf63eb8d1.jpg

有大佬说是布线问题,驱动芯片到MOS管栅极布线确实很长,有6~9厘米
把阻焊刮了镀了一层锡,感觉没啥效果

把R72,就是靠近MOS管的栅极电阻加大后的Vgs波形,
474a81a30bed21c8f28b68558d6966b.jpg

开通上冲没有了,但是关断之后的波形很难看,

Vds的波形更难看
75b78d5f2cd0903d7e414d3c35aa636.jpg

看了别人的帖子,在DS两端并RC也试过,电阻烤糊了,并且感觉这样做并不可靠,一般正常的电路不会这么干


我现在是没啥法子了,就靠论坛各位大佬指点一二了


谢开源
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LV10
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  • 2022-7-3 09:23:54
 
大功率测试极易受干扰,请去掉探帽就近测试Vgs试试
多嘉腊孜
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LV6
高级工程师
  • 2022-7-3 21:51:05
 
功率不大啊,就100多瓦,测试也没带探帽
谢开源
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LV10
总工程师
  • 2022-7-4 09:42:11
 
那只能说你的布板实在太差,改layout吧
hlmwf1314
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LV8
副总工程师
  • 2022-7-4 15:03:58
 
应该是你的功率回路走的太长,带入了很多干扰,功率回路要尽量短且铺铜够宽;且不同的功率回路不要有交叉
可以把的layout图贴上  看看
另外 你才100多W 咋会用全桥LLC  这不是牛刀杀鸡吗
多嘉腊孜
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LV6
高级工程师
  • 2022-7-17 11:06:41
 
layout确实被很多人诟病,已经改版了
多嘉腊孜
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LV6
高级工程师
  • 2022-7-17 11:09:30
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不是做产品,实验室条件有限,主要是搭个样机出来做实验
YTDFWANGWEI
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版主
  • 2022-7-4 17:15:18
 
镀锡没用,这个又不是过电流的原因,还不如割线双绞走线试试。
多嘉腊孜
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LV6
高级工程师
  • 2022-7-17 11:07:56
 
镀锡主要是想看看走线电感能不能降低点
ruohan
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LV8
副总工程师
  • 2022-7-5 08:53:56
 
这个是隔离驱动的芯片吗

多嘉腊孜
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LV6
高级工程师
  • 2022-7-17 11:04:31
 
SI8233隔离的,5Kv
电路菜鸡
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LV6
高级工程师
  • 2022-12-6 21:53:12
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请问您问题解决了吗?我现在也是这个问题
多嘉腊孜
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LV6
高级工程师
  • 2023-1-6 21:53:10
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重新画板子了,把板子板小了很多,把驱动芯片单独做了个小板,放的离MOS管近一些,MOS管改用贴片的了,具体是哪的问题也不好说
Jwen
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LV3
助理工程师
  • 2022-12-7 10:59:02
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用最短地线法测Vgs波形排除杂讯干扰,若问题仍存在则检查驱动回路PCB布局,尝试加大Ron驱动电阻(LLC的Ron放1~2百欧都可以的)、对于LLC来讲死区时间是否足够会不会存在共通现象


LLC芯片用哪个呀?还有就是你的Vds波形怎么才10几V,
多嘉腊孜
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LV6
高级工程师
最新回复
  • 2023-1-6 21:56:42
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谢谢提供的思路,我这个是用单片机发的波,跑的开环,输入电压就是不高,做的样机,拿来学习的
power__rookie
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高级工程师
  • 2022-12-7 17:39:06
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刚刚看了大神“能源消耗”的贴子,不放用这个电路试下,我仿真了下,很不错。
图片1.png
power__rookie
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高级工程师
  • 2022-12-7 17:40:27
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https://bbs.21dianyuan.com/thread-331770-1-1.html?fromuid=155113这是大神贴子的链接,楼主可以去围观学习下。
多嘉腊孜
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  • 2023-1-6 21:53:51
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谢谢
ruohan
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  • 2022-12-14 13:59:44
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加输入电压和不加输入电压是什么意思,
8233隔离驱动的电压吗

多嘉腊孜
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高级工程师
  • 2023-1-6 21:49:28
  • 倒数4
 
就是输入电压啊,就是LLC的输入电压,电源输入输出的那个输入
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