DDR阻抗和反射的问题？-综合电源技术-世纪电源网社区

Jarfaders

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2019-1-21 16:45:02

10问答币

提问：1）假设SOC的内部阻抗在48欧姆，外部传输线走了50欧姆的阻抗，而内存的ODT设置了60欧姆！7 {& u( I$ J) }/ p7 d& ?
请问会不会对信号来说负载加重了。出现了阶梯。还有信号到了内层，阻抗变得不连续了。而导致反射？？？. _8 d- \' N9 ?. m1 V
2）假设SOC内部30欧姆阻抗，外部传输线60欧姆，内存也60欧姆。8 n8 d% p& ~# \0 \
请问这种状况信号会不会刚从SOC出来就抖动。出现反射现象？？？7 t5 a- I K: P4 i& U4 O# u
3）为什么在并联端接VTT后信号的反射会被吸收呢？？？: ^

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JUEYANDIAN

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2019-2-15 12:30:06
倒数6

如果考虑数据线，是点对点的，个人觉得用仿真工具跑一下比较好，后仿真。
老的DDR一直是用stub termination的方式，也就是串阻和VTT termination相结合的方式。
现在的新一代的DDR，基本去除了数据线外面的电阻，串阻和VTT的方式都不需要外部termination，我们只需要动态调整 ODT， Vref就可以了

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wangdongchun

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2019-2-15 12:45:09
倒数5

对于第一个问题个人认为还是可以承受的毕竟DDR对于外接负载是有一定范围的

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2019-2-15 17:05:03
倒数4

2. 不会有反射。
3. 不是吸收了，而是反射不会发生。

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2019-2-15 19:12:19
倒数3

不会对信号来说负载加重,设置了60欧姆,不一定就能能达到60欧姆。

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			6 a422877308 a422877308 离线 LV8 副总工程师积分：3490 \| 主题：19 \| 帖子：533 访问空间发消息积分:3490 LV8 副总工程师 2019-3-18 09:45:07 倒数2
			1.负载是加重了，反射发生在所有阻抗不连续的地方，导致阶梯状波形的一个原因是负载加重导致上升沿被拉下来，第二个原因是反射于串扰共同作用的结果。FEXT端形成的负电平串扰经由会影响上升沿。 2.源阻抗于传输线和负载不匹配，当然会有反射。 3.并联端接也是一种阻抗匹配方式。回复 \| 举报 \|

		7 zb980124 zb980124 离线 LV6 高级工程师积分：490 \| 主题：4 \| 帖子：115 访问空间发消息积分:490 LV6 高级工程师最新回复 2019-8-10 17:51:09 倒数1
		1, 会有部分反射 2，不会有反射 3，阻抗匹配了回复 \| 举报 \|

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