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未解决

NMOS+PMOS控制电池电压输出

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QWE4562009
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总工程师
  • 2021-9-24 18:40:57
10问答币
NMOS+PMOS控制电池电压输出

1.在MCU_CTL给高电平的时候,Q5、Q1导通,BAT_OUT输出电池电压3.7V,这个没问题

2.在MCU_CTL给低电平的时候,Q5、Q1截止了,为什么BAT_OUT输出还是有0.2V左右,是什么原因?如何改善这个bug

3.按照PMOS体二极管的内部结构,由D→S,所以S接的是BAT,这个接法是正确的

NMOS PMOS.png (14.31 KB, 下载次数: 44)

NMOS PMOS.png
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谢开源
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LV10
总工程师
  • 2021-9-24 19:03:57
 
R3改小为100K试试,
QWE4562009
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LV10
总工程师
  • 2021-9-26 18:15:41
  • 倒数7
 
R5吧  哪里来的R3  改小了更耗电啊
joezzhang
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LV8
副总工程师
  • 2021-9-24 19:20:06
 
Q1的Ciss和Q5的Coss分压?
在Q1的栅极和Q5的漏极之间串一个几百到1k欧姆的电阻看看?
QWE4562009
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LV10
总工程师
  • 2021-9-26 18:16:14
  • 倒数6
 
这个有可能
尚飨
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LV8
副总工程师
  • 2021-9-24 21:03:11
  • 倒数10
 
看下你的NMOS关闭状态的漏电流,乘以你的PMOS的栅源级电阻,再乘以你PMOS的g,是多少?看看是不是本身就关闭不到0
QWE4562009
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LV10
总工程师
  • 2021-9-26 18:19:00
  • 倒数4
 
1.漏电流貌似不好测试啊
2.PMOS的栅源级电阻=2M,再乘以你PMOS的g?这个是多少
st.you
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LV10
总工程师
  • 2021-9-24 23:30:47
  • 倒数9
 
这个电压值很可能是MOS漏电(也可能是MOS的 D  S焊盘之间漏电)和万用表内阻的分压。
QWE4562009
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LV10
总工程师
  • 2021-9-26 18:17:39
  • 倒数5
 
非常独特的一个观点   有必要考虑
能源消耗
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LV10
总工程师
  • 2021-9-25 09:47:52
  • 倒数8
 
R2 兆太大了,      Q5缺对地电阻。   
QWE4562009
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LV10
总工程师
  • 2021-9-26 19:12:32
  • 倒数3
 
D和S之间漏电很小的MOS  大家有没有推荐
l000z
  • l000z
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LV3
助理工程师
  • 2021-10-23 15:25:40
  • 倒数2
 
可以参考下;

00.jpg (109.81 KB, 下载次数: 42)

00.jpg
QWE4562009
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LV10
总工程师
最新回复
  • 2021-10-26 17:39:38
  • 倒数1
 
你这个和我那个图有啥区别?我实际上有加下拉
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