| | | | | 因为只对输出电流分析,故侧重输出电流走向,但大体看下VDS IDS...
满载输出电压工作于CCM下,输入电压定为200VDC,差不多150VAC.
蓝色为VDS,红色为检测电阻上的电流,绿色为IDS.
放大后发现,Ids与检测电阻Rcs上的电流区别还是蛮明显的:
再细化,可以看到尖峰及VDS IDS的交叠:
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| | | | | 输出整流二极管上的电流及电压波形:
可以看到VPP=100V,Ipk=2.8A左右 |
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| | | | | | | 流入第一个电容C8中电流波形及滤波电感中的电流波形;
C8中电流1.1A左右,变化趋势(频率等)与二极管中相同
L4输出滤波电感中的电流为直流,1.7A左右.
来一张全景的:
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| | | | | 那么此时另一个电容中的波形呢?
C9?
C9中的电流比较小,接近为0,也是接近直流量.
C9 假负载, 负载上的电流波形如下:
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| | | | | 由3/4楼,我们似乎可以得出一个结论: 整流后第一个电容上的电流最WORSE,即流过的电流最多,越到后面,级数越多,上面的电流越小.---需要进一步验证.
所以: 整流后第一个电流的纹波电流值选择要比后面的大.(暂时的结论). |
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| | | | | 也许大家看到了CLC波滤级中的L,那么现在所有的不动,直接去掉L4,留下二个电容C8 C9,电路图如下:
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| | | | | | | 结果:
D3上的电流不变:仍为2.8A, C8上的电流增加到了1.26A,C9上的电流也开始增加.
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| | | | | | | | | 再狠点,去掉C9:因为C9貌似在这里没作用:
结果D3上面的电流显然不受影响,但C8上的电流在正向端变回1.17A,但负向端却急剧上升...
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| | | | | | | | | | | | | 仿真在这里有一个局限性,就是原边和次级的gnd都是同一个地。如果能够解决不是共地的问题,那么这个IRCS或许不会更大。当然,目前还没有找到和想到解决的办法。
主要是软件方面,不容许有两个回路,否则他判断为floating的,这直接会导致软件仿真不收敛而无法仿真下去。
还需要寻找其他办法或模型来替代。 |
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| | | | | | | | | | | | | | | | | 恩,所有的软件,不论是免费的还是几百万美金的软件,目前都不容许在一个电路里有两个回路。必须共地,这个就是软件的局限性。 |
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| | | | | | | | | | | | | | | 可不可以在原边只用一个地,将此地连一个M欧级的电阻到副边"地"? |
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| | | | | | | | | | | | | | | | | | | 更新:回13/15/17楼,关于原副边不共的问题:
昨晚及刚才仿真试了下,结果如下:
1. 就1楼所示电路,将副边"地"去掉,从原边接一个大电阻(2M-200M)到副边,仿真仍可以进行,对结果基本上无影响.
2. 此电阻值越大,仿真速度愈慢,加个200M仿真近半个小时才完成.
3. 由此看来,仿真软件基本上对原副边地不区分的. |
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| | | | | | | | | | | 副边去掉一个电容,另外一个电容电流应该是更大才对,为什么还会变小?
负向端电流上升这也可以解释的出来,但是急剧上升这个好像不太对劲吧,是不是电容的内阻没有设置好? |
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| | | | | | | | | | | | | 谢谢你的关注,C8是没有设置ESR.下面的仿真都会说明设置情况. |
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| | | | | | | | | | | | | 更新: 刚才重新仿真了下,加入了ESR,但结果仍是一样. |
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| | | | | 不错的帖子。
免费赠送一个TIP:
副边地跟原边地之间加nF级别的电容相连来解决地的问题。仿真速度刚刚的。 |
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| | | | | | | 类似于Ycap?
哈哈,自己尝试着想过,但没试,就直接用大电阻了,等下马上试下.
但是一个问题是,副边的"地"的符号要不要加上,如果加上了,这个isolated capacitor还有意义吗? |
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| | | | | | | | | 这个电容就是解决仿真中不能有两个回路的限制,实际中没什么意义。
大电阻降低spice仿真速度的原因,是降低了仿真间隔,也就是仿真步长变小;这是跟Spice的算法相关的,因为它要保证精度tolerance,大电阻两端电压变化,流过的电流很小,缩短的步长主要就去保证 I大电阻 了,其他啥都没干... |
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| | | | | | | | | | | | | | | 1/2在仿真中都行得通.对结果也无影响,不过更倾向于solution 2.
结果表明:
1. 加入这个隔离电容比电阻仿真要快几十倍.
2. 29楼及其以上仿真的结果都因不因为共地而影响,即共地与非共地在仿真结果是一致的. |
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| | | | | | | | | | | | | | | | | | | @文工 , too
其实第一种情况,加的电感没有加入到netlist中,因为其两端都是gnd. |
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| | | | | 再来一个,有朋友告诉我,说改变驱动电阻对输出纹波有影响,下面仍以此图为例,仿真下.
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| | | | | | | | | | | | | | | Rgate=1000 R.驱动波形及输出波形:
此时驱动波形已经彻底凌乱了... |
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| | | | | | | | | | | | | | | | | 必须有影响,跟实际中是一样的。
trise,tfall全靠它了。 |
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