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如何降低LLC空载纹波?

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laus
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本网技师
  • 2012-9-26 22:06:52
小弟做过几个LLC电源。发现LLC在空载工作时,多数电源工作在Skip cycle模式下,虽然输出电压稳定,没有任何问题。但此时纹波却较大,一般达到满足时的10倍左右。
对于此情况,一直没有找到好办法解决。以前曾测试过一两款国外大公司的整流器,发现其空载下,不出现Skip cycle模式工作,故而输出纹波非常小。

请问有高人处理过这种问题吗?我个人认为空载调占空比的办法是可以解决的,但一直没有做过实验。故而只是猜测!
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daxia4540827
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总工程师
  • 2012-9-26 22:29:56
  • 倒数10
 
BURST模式下的纹波也不大吧!
laus
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本网技师
  • 2012-9-27 15:30:47
  • 倒数9
 
如何称为大呢?
对于30V以下输出电源,我们一般要求不大于100mVpp,有些要求不能大于50mVpp。
daxia4540827
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总工程师
  • 2012-9-27 18:30:25
  • 倒数8
 
那你现在纹波超出多少呢?
laus
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本网技师
  • 2012-9-27 21:23:25
  • 倒数6
 
有些电源能做到200mVpp左右,有些较高,400-500mVpp。有些假负载大些,可以100mVpp之内。但对于50mVpp之内,太难做了。

实测其他公司的电源,空载纹波一般30mV之内。太吓人了。
Bodoni
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总工程师
  • 2012-9-27 20:42:44
  • 倒数7
 
跟主控IC有关。。
楼主的纹波波形是怎么样的?
希望能针对楼主的电路下对策。。
laus
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本网技师
  • 2012-9-27 21:25:44
  • 倒数5
 
我多数情况用NCP1396A做LLC,也有些电源用L6599做。至于纹波,就是常见的跳周期电源的那种形状。
天下第一
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高级工程师
  • 2012-9-27 22:38:08
  • 倒数4
 
试着减小Lp变压器感量和Lr谐振电感感量的比值,一定会有效果,但是会牺牲一点效率。
增大一点死区时间。
NCP1396,FAST脚的俩电阻多少啊?
laus
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本网技师
  • 2012-9-28 14:33:21
  • 倒数3
 
减少 Ln = Lp/Lr 比值,这个我理解;
死区大,其实就是减少占空比,这个也理解;

Fast 脚电阻 一般取 43k/10k,或 5k6/3k 等。这个没有仔细研究过,不知道有什么规律,还望赐教!谢谢!
天下第一
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LV6
高级工程师
  • 2012-9-29 00:01:33
  • 倒数2
 

就是要降低空载的工作频率.
1,增加假负载,相当于增大了Q值.视在空载的工作频率当然下降.牺牲效率,
2,减小k值,增加Q值曲线的下降斜率,空载Q直曲线相同增益下k值小的对应的频率低,牺牲效率
3,反过来推,谐振网络的参数不变,降低空载工作频率,那么谐振网络的增益就要加大,那么为了维持输出比输入的增益不变,就要减小变压器的增益,那就减小次初级的匝比,或者减小谐振网络的输入电压即PFC电压.
4...
蓝色的天空
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副总工程师
最新回复
  • 2012-9-29 09:43:41
  • 倒数1
 
最高频率设高点应该有帮助,还有环路响应更快点吧。
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