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| | | | | | | | | | | 那可以肯定这几个件白放了,去掉节省点成本吧。如果是实际产品,方便可以贴下完整电路、型号,没准用于某种控制? |
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| | YTDFWANGWEI- 积分:109912
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| | | | | | | | | 这么绝对?
C3上的电压通过R10放到输出电容上去。
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| | | | | | | | | | | | | 说白了,就是将MOS管的尖峰能量通过R放到输出电容上去,而不是通过R来完全消耗掉 |
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| | | | | YTDFWANGWEI- 积分:109912
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积分:109912 版主 | | | | | | C3上的电压为什么会高于输出电压?合理布局这个是没必要的。 |
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| | | | | | | YTDFWANGWEI- 积分:109912
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| | | | | | | | | YTDFWANGWEI- 积分:109912
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| | | | | | | | | | | | | | | | | | | | | 相差1V左右的管压降,因为模型建立可能不是很准确,所以很多寄生参数的特性表现不出来 |
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| | | | | | | | | | | YTDFWANGWEI- 积分:109912
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积分:109912 版主 | | | | | | | | | | | | 那哪里是1V,290V左右的是不是输出的?也就是D4右边的? |
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| | | | | | | | | | | | | C3上的电压不就和MOS上电压差一个二极管压降么?
MOS上的电压不会高于输出电压? |
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| | | | | | | | | | | 是啊,从电路取值看功率不大,功率回路应该不难设计,没必要单设个吸收电容。这样设计远不如按RCD吸收缓冲关断时电压上升率
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| | | YTDFWANGWEI- 积分:109912
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| | | | | Q3关断,L1和杂散电感串联通过D3和C3续流;
Q3开通,C3通过R10向输出放电。
如果Q3的Cds接近或者大于C3,这个电路的作用就很有限;
同时如果C3太大,L1中的能量过多的转移到C3上,会导致R10上的损耗增加、效率降低。
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| | | YTDFWANGWEI- 积分:109912
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积分:109912 版主 | | | | 如果C3上的电压高于输出电压,那么在MOS管关断过程中,为什么不直接通过主二极管向输出流通而是通过D3流向C3? |
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| | | | | | | | | 因为从L1到Q3之间不是理想导线,总有一些杂散电感,但杂散电感一般来说很小,所以C3也不宜过大。D3和主二极管的压降也不一样。
C3和输出电容是并联关系,在C3电压不高过输出电容太多时,因不同的二极管压降,会有部分电流流向C3。
如果布局和走线优化一下,同时Q3留够足够的耐压余量,这几个器件是完全可以省掉的,至少我从来没用过。不过原理上分析,某些场合还是有一定的作用。
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| | | | | YTDFWANGWEI- 积分:109912
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积分:109912 版主 | | | | | | 在D2位置是电感而不是二极管的时候,这个电路用过。 |
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| | | | | | | 1)其实这个电路把bulk电容和负载加上就好理解一些。
2)我用Pspice仿真过,C3点的电压是要比输出稍高一点,看起来C3没有其他放电路径,只有在通过R10流到输出端去。
不过我今天仿真时没有考虑Q3的Coss所以,模型建的不是太准确。 |
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| | | | | | | 就是个放电阻止型RCD吸收电路。用百度搜的,也没具体明白。 |
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| | | | | | | 电路明显是新手画的,明显画错了。
功能无非有两个嘛!
其一,RCD吸收电路,0.5W的电阻太小了;
其二,EMI抑制,R9、C2肯定效果来的更直接。
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| | | | | | | | | | | | | | | 2KW这么用还不错,可以降低点布线要求。做仿真往MOS上串联个杂散电感就看到效果了。不过330uH的电感做2KW有点忒奢侈了。
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| | | | | | | | | | | | | | | | | 可以这么说,MOSFET关断的尖峰其实杂散电感所引起的原因是很小的一部分而已,并不是真正的元凶啊。 |
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| | | | | | | | | 准确的说应该是给输出电容预充电的,防止电感刚上电时饱和。
另外这个电路在大功率时是正确的,R10上的功耗不会很大的,一般1-2W的电阻就够了的。 |
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