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BACK电路驱动自举电容电压跌落、驱动变形、输出过冲,求理论分析、讨论

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anlikon
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LV6
高级工程师
  • 2013-7-2 07:45:16
仿真了一个BACK电路,出来的结果很奇怪,见图:
占空比50%的脉冲,驱动BACK电路,未加反馈。输出却冲到略50V,再回到30V的平衡点。其个原因是什么?怎样来改善?
2:在1.2ms的位置。驱动的VCC电源电压有一个下跌,这是什么原因?
展开此处波形,推挽电路的前后明显变形,MOS管的栅极电压脉宽增加了,这会是真的么?

各位大仙看看,如果有兴趣的话,来讨论一下:
这个仿真的效果会是实际电路的真实反应吗?
出现这样的效果,原因是什么?


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basso
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LV6
高级工程师
  • 2013-7-2 11:42:57
 
仿真能看到示波器看不到的东东 ,还是可信的。呵呵~
anlikon
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高级工程师
  • 2013-7-3 14:15:30
 
没人气,也难怪!这个问题比较复杂,一般人分析不了,需要坚实的理论分析能力。
对自举驱动、BACK电路及电感充电储能、续流释放能量有充分的认识。
请路过的高人花点时间阐述一下原理!
myship02
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  • 2013-7-4 15:35:03
 
关注一下,对仿真不熟呀,呵呵
anlikon
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LV6
高级工程师
  • 2013-7-4 15:49:40
 
谢谢关注。我们首先要相信工具软件,它出来的结果我们要电路原理上分析它的成因。
如果驱动真的变宽了,在应用中就会增加电感的导通时间,增加磁芯饱和的风险,引起振荡。
电子古董
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  • 2013-9-24 10:09:06
 
莫说这个电路有多复杂,其实也差不多。
楼主的这个电路有很多错误的地方。其一:VCC的电容负端应该接到GND才正确,这么接就会出现你说的这个现象;其二:你所说的推挽电路不叫做推挽电路,而是加强三极管、达林顿管、MOSFET、IGBT等功率器件驱动能力的图腾驱动电路,并且接反了。应该是上管用NPN,下管用PNP才对……
楼主不妨一试……
anlikon
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LV6
高级工程师
  • 2013-9-26 09:00:58
  • 倒数7
 
一:VCC电容负端接地是不对的;那样MOS管导通时,S极电压应为60V,而你Vcc电容上的电压只有12V,是不能满足MOS管的驱动电压要求。
二:不管它叫什么,就是图示的这个驱动电路。看图示:上管是NPN,下管是PNP,你看错了!
nc965
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  • 2013-8-19 15:35:36
 
这个纯粹是玩,多玩几下就把你的问题玩没了。
anlikon
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LV6
高级工程师
  • 2013-8-19 17:26:59
 
这个还请大师多考虑一下。
此电路我也是帮网友分析问题时发现的,在BACK电路启动时出现的暂态过程。有条件的网友可实际测试一下。
MOS管的栅极波形的宽度超过了给它的驱动波形,这在电源中应该不是一个小事情。
搞清这些问题还是很有必要。
threetigher
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LV8
副总工程师
  • 2013-8-19 20:50:53
 
呵呵。

lz将5K上拉电阻改改,对比一下结果。
threetigher
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LV8
副总工程师
  • 2013-8-19 20:51:23
 
另外请修改一下标题。
nc965
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  • 2013-8-20 09:19:44
 
主要问题是,这个仿真只是“仿”、不“真”
要研究楼主的问题,一定要“真”,而真实的情况是,两个电压源太理想,实际不是这样的。实际情况应该是同一个交流电源、整流、滤波、降压,得到同一个(或者同时两个)直流电源,这中间有太多过程,这些过程显然会影响到楼主观察到的所谓暂态过程。也就是说,楼主所谓的暂态过程,在真实情况下并不会出现,因此纠缠它有什么价值呢?
anlikon
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LV6
高级工程师
  • 2013-8-20 09:43:05
 
我的观点有所不同,对这个问题也有一个初步的分析,认为是存在的。
现在有点忙,抽空实际测试一下,贴出波形再来讨论。
这个电路可以简化!把60V的电源改为12V,与驱动电源用同一个直流电源,这样试验就方便很多。希望有这实际电路的网友能帮忙测一下更好!
先到这里吧!谢谢!!空了再来请教!

anlikon
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LV6
高级工程师
  • 2013-9-23 18:04:10
 
这个帖已沉许久了,终于有时间来做这个实验了!
由于手上的器件有限,调试了几天,终于将仿真的结果在实际中线路中实现出来了!
由于没有信号源,用LM339搭了一个;动时暂态过程的频率很低,稳定后工作在65K,占空比约为50%; 因此试验时12V电源一直通电,只是通断60V电源来验证数据,测试结果为如下波形:
第一个图:1通道为前级驱动、2通道为MOS管的G极波形(明显比前级宽,);
第二个图:1通道为输出电压(明显上冲)、2通道为悬浮驱动的电源(C2的电压,明显有个下跌)波形;



后级MOS管的G级波形,明显比前级宽,会有负面影响吗?
输出电压上冲怎样形成的?怎样减小或消除?
悬浮驱动的电源,及C2上的电压,怎么会产生一个下跌呢?
有兴趣的朋友,可以上来讲讲,这个现象的成因!
把这个分析清楚了,相信分析能力会有很好提高
z5071507
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LV4
初级工程师
  • 2013-9-24 09:46:42
 
你这个2通道为MOS管的G极波形变宽是稳定工作后都是那么宽还是每个周期内都存在前面窄的状态和宽的状态?(也就是说是不是只有启动的时候2通道为MOS管的G极波形比较窄,变宽了之后就保持这个状态了?
anlikon
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LV6
高级工程师
  • 2013-9-24 11:55:34
 
只是在输出上冲后下降过程中的中间一个状态,稳定后就正常了!
st.you
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LV10
总工程师
  • 2013-9-24 10:28:56
 
原理上,你的前级驱动信号跟MOS的G极驱动信号,应该是反相。
输出电压似乎有问题,按50%占空比计算,怎么也有个30V吧?这里才不到20V。
anlikon
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LV6
高级工程师
  • 2013-9-24 12:04:16
 
前级指的是第一个三极管的C极,你看第二个图就对了,同相!
输出电压实测是28V,应该是有管压降的影响。
从我的波形来看,是不到20V。因为实际电路中过冲达不到仿真的48V,改了一下负载,改了一下电感、也改了一下输出电容,主要是找这个变形的波形,找到了就发出来了。当时没注意这个问题。
不过没关系,主要分析原理!
anlikon
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LV6
高级工程师
  • 2013-9-26 14:44:34
  • 倒数4
 
今天得空重新测试了一下,把输出电阻先调好后再接到电路里。重上波形:






st.you
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LV10
总工程师
  • 2013-9-26 15:44:09
  • 倒数3
 
电感有没有可能会饱和了呢?
anlikon
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LV6
高级工程师
  • 2013-9-26 15:53:38
  • 倒数2
 
没可能,电感是我原来做的PFC电感,电感量太大,只用了半只磁芯。
楚天?
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  • 2013-9-24 10:46:01
 
上冲是因为初期输出电容电压为0,所以施加在电感两端的电压并不是平衡态的1/2Vin,而是Vin。后期的电压回落也是同样道理。理想电感不会饱和,所以问题只是表现出一个减幅震荡。实际电路可能会因为饱和而炸管。这个震荡的频率和主输出的LC谐振相关。你可以增减LC,就能看出规律了。
对于感性器件,观察电流效果会更好一些。
对于自举电容的电压问题,要考虑的更多一点。要分析自举升压的充电回路,放电回路及其受到关联电路的影响才可以。
既然你要分析暂态过程,那么理论模型就不要太粗糙。
事实上,仿真和实际的区别就在于此。仿真模型为了简化计算和收敛结果,往往对模型进行适当的取舍,关键在于--取舍的标准问题。专业软件和通用软件的区别不是技术,而是和用户目的的贴近程度。
上面仿真其实和很多初学一样,忘记了分析电感。你再做一下,看看电感电流就知道了。
anlikon
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高级工程师
  • 2013-9-24 12:56:05
  • 倒数10
 
这么多高人都来了!谢谢关注!!
每个脉冲给电感增加的电流是(Vin-Vo)/L X T/2,放电电流是-Vo/L X T/2,在在充电初期,Vo低于Vin/2,在一个周期内,电感电流增加的多,减少的少,因此,Vo逐渐增加。上冲过后的下降,正好反过来了!
这里再问个问题:Vo从0逐渐增加,当增加到Vin/2时,电感电流增加的和减少的正好相等,怎么就冲过了呢?
楚天?
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  • 2013-9-24 15:21:53
  • 倒数9
 
上面提到过,这个问题就是LC谐振。
首先,这个系统可以简化为50%占空比的方波电压源后面带一个L-C//R的电路。初始由于Vc=0,导致L的伏秒积不为零,也就是说高电平期间电感的电流增量在副半周期间不能完全释放,导致平均电流增加。随着Vo的增加,正副半周之间的电流增量差异逐渐变小,但是电流总体是增加的------注意,电路分为两部分,一部分给电容充电,转化成电场存储,另一部分由电阻泻放。当Vo=1/2Vin时,电流增量为0,但是此时电容不再吸收电流而全靠电阻泻放电流。如果电阻的电流小于电感电流,则多余的电流会继续给电容充电,电感的平均电流会继续下降,但是电容的电压会逐渐升高----直到电感电流小于电阻电流时,电容反过来放电和电感一起给电阻供电,此时电压开始回落。。。。。你还是去看看LC阻尼震荡的描述吧。打字太累。不管是IL>IR还是IL<IR,系统电压都不会恒定。
你可以通过仿真时改变电阻的大小来查看过冲情况。
实际上,通过多做几次仿真就能够分辨出RLC对输出电压波形的影响了。
楚天?
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  • 2013-9-24 15:26:36
  • 倒数8
 
PS:既然是仿真,你可以方便的做下面一个实验,然后看看波形就知道了。
直流电源通过开关后串联电感,然后通过一个电容与电阻的并联回路接地。这个电路的波形同你前面的曲线应该是一样的。
由此,我把D=50%的Vin用黑盒子装起来,再把1/2Vin的电源也装起来,两个黑盒子和你后面的LCR衔接,然后你测量R两端电压发现曲线一样。无法分辨出那个盒子是开关电源,那个盒子是直流电源。那么50%Vin的开关电源1/2Vin的电源就应该是等效的。
anlikon
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高级工程师
  • 2013-9-26 09:43:25
  • 倒数5
 
你这个建议我就不做了。因为我们讨论的是暂态过程,如果是稳态,应该是可以做的。
现在要分析产生上冲的工作机理,及驱动变形的问题。
如果有导通时间变宽,电感的伏秒数就会增加,增加磁芯饱和的风险。
anlikon
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高级工程师
  • 2013-9-26 09:31:06
  • 倒数6
 
再讨论讨论:
一:“随着Vo的增加,正副半周之间的电流增量差异逐渐变小,但是电流总体是增加的”——这个认可;
二:“当Vo=1/2Vin时,电流增量为0,但是此时电容不再吸收电流而全靠电阻泻放电流。如果电阻的电流小于电感电流,则多余的电流会继续给电容充电,电感的平均电流会继续下降,但是电容的电压会逐渐升高”
——这个有待深化。这里用了“如果电阻的电流小于电感电流”来解释上冲,是建立在一种假设(按字面理解);“小于”是其中一种假设,“等于”、“大于”是另外的假设。
看看波形,后面的输出电压是一个恒定直流,电感正半周增加的电流正好被负半周释放,电感的平均电流与负载电阻的电流是相等的。
楚天?
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  • 2013-9-27 10:55:30
  • 倒数1
 
所谓暂与稳都是相对量。要看你的关注点。你说的是Vo波形的上冲,Vo包络看起来就是个很明显的阻尼振荡。
至于电阻电流,如果电阻是理想的则在第一个波峰时是一定小于电感电流的。不信你可以去计算。
你要看每个周期的脉冲,那就要假定Vo及Vc在相邻几个周期内不变。否则时间跨度太大就成了双重标准了。
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